Während der Eröffnungs-Keynote zum Intel Developer Forum gab Intel-Chef Paul Otellini neue Details über Intels übernächste Prozessorgeneration Nehalem bekannt. Am Nachmittag des ersten IDF-Tages waren von Pat Gelsinger, Chef der Digital Enterprise Group, weitere Details zu erfahren.
Zuerst demonstrierte Pat Gelsinger ein 2-Sockel-System mit Quad-Core-Nehalem-Prozessoren im Betrieb. Jeder Kern von Nehalem beherrscht mit dem „Simultaneous Multi-Threading“ zwei Threads. Pro Quad-Core-Nehalem sind damit acht Threads, durch den 2-Sockel-Betrieb insgesamt 16 Kerne, für das Betriebssystem sichtbar.
Neu in Nehalem ist der Befehlssatz SSE4.2. Intel fügt zu den bei Penryn eingeführten 47 SSE4-Befehlen sieben neue Instruktionen hinzu. Beispielsweise sollen damit 256 compares mit einer Instruktion möglich sein. Des Weiteren gibt des den Financial Market Data Parser. Für Finanzberechnungen soll sich mit dieser SSE4.2-Erweiterung die Anzahl der Instruktionen um 75 Prozent reduzieren und die Performance um den Faktor drei steigern lassen.
In dem 2009 nach Nehalem folgenden „32-nm-Shrink“ Westmere integriert Intel zusätzlich den Befehlssatz AES-NI. Diese Instruktionen sollen die AES-Verschlüsselung um den Faktor 3 beschleunigen. AMDs angekündigten SSE5-Befehlssatz wird Intel in seinen künftigen Prozessoren übrigens nicht unterstützen, wie Pat Gelsinger auf Nachfrage von TecChannel betonte.
Nehalem: 3-fache Speicherbandbreite im Vergleich zu AMD
Die in Nehalem integrierten Speicher-Controller können je nach Konfiguration gepufferte oder ungepufferte Speichermodule ansprechen, wie Gelsinger angibt. Als Chipsatz für Nehalem kommt der I/O-Hub Tylersburg zum Einsatz. Gelsinger zeigte zudem, wie die Systemarchitektur mit zwei und vier Nehalem-Prozessoren über die QuickPath-Interconnects aussieht. Beispielsweise kommunizieren in einem 4-Sockel-System die Nehalem-CPUs über je drei QuickPath-Verbindungen miteinander. Über einen vierten QuickPath-Interconnect sind die I/O-Hubs angebunden.
Laut Intel soll Nehalem eine bis zu dreifache maximal erreichbare Speicherbandbreite im Vergleich zu konkurrierenden Prozessoren erreichen. Damit spielt Intel auf AMDs CPUs mit ihren integrierten Dual-Channel-Speicher-Controllern an. (cvi)
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